https://libeldoc.bsuir.by/handle/123456789/42769
Title: | Устройство итеративного кодирования и декодирования сверточных кодов |
Other Titles: | Пат. 6593 U Респ. Беларусь |
Authors: | Королев, А. И. Конопелько, В. К. Аль-Алем Ахмед Саид Калашников, Г. А. |
Keywords: | патенты;сверточные коды;итеративное кодирование;итеративное декодирование |
Issue Date: | 2010 |
Publisher: | Национальный центр интеллектуальной собственности |
Citation: | Устройство итеративного кодирования и декодирования сверточных кодов : пат. 6593 U Респ. Беларусь : МПК (2009) H 04L 1/00 / Королев А. И., Конопелько В. К., Аль-алем Ахмед Саид, Калашников Г. А. ; заявитель и патентообладатель УО Белорусский государственный университет информатики и радиоэлектроники. – № u 20100038 ; заявл. 19.01.2010 ; опубл. 30.10.2010. – 7 с. : ил. |
Abstract: | Устройство итеративного кодирования и декодирования сверточных кодов, содержащее передатчик, в состав которого входят источник информации, кодер и генератор, выход которого одновременно подключен к источнику информации и к первому входу кодера, второй вход которого подключен к выходу источника информации, а два выхода кодера являются выходами кодера сверточного кода, а приемник содержит последовательно соединенные кодер и формирователь синдрома, второй вход которого и вход кодера являются входами итеративного декодера сверточного кода, а выход формирователя синдрома одновременно подключен к первому входу анализатора синдрома и через первый, второй дополнительные и основной регистры ко второму входу анализатора синдрома, третий и четвертый входы которого подключены к первым входам соответственно первого и второго дополнительных регистров, а вторые входы первого, второго дополнительных и основного регистров подключены к первому входу соответственно первого дополнительного порогового обнаружителя, двухпорогового обнаружителя и второго дополнительного порогового обнаружителя, а вторые входы данных пороговых обнаружителей подключены соответственно к первому, второму и третьему входам анализатора синдрома, а выходы первого, второго дополнительных пороговых обнаружителей и двухпорогового обнаружителя подключены одновременно к вторым входам первого, второго дополнительных и основного регистров и к первым входам последовательно соединенных первого, второго и третьего корректоров ошибок, вход первого корректора ошибок подключен к входу кодера, а выход третьего корректора ошибок является выходом итеративного декодера сверточного кода, отличающееся тем, что в передатчике введены второй кодер, четыре ключа управления, два оперативных запоминающих устройства и формирователь сигналов управления ключами передатчика, выходы которого подключены к первым входам ключей управления, а вход формирователя сигналов управления ключами передатчика подключен к выходу генератора, а выход источника информации подключен через первый ключ управления, первый кодер, первое оперативное запоминающее устройство, второй ключ управления, второй кодер, третий ключ управления и второе оперативное запоминающее устройство ко второму входу четвертого ключа управления, выход которого является выходом итеративного кодера сверточного кода, а в приемнике введены пять ключей управления, второй пороговый декодер, буферное устройство, первое и второе оперативные запоминающие устройства, мажоритарный элемент и формирователь сигналов управления ключами приемника, выходы которого подключены к первым входам ключей управления, а вход формирователя сигналов управления ключами приемника подключен к выходу генератора, а второй вход первого ключа управления является входом приемника устройства итеративного декодирования сверточного кода, а выход первого ключа управления подключен к входу первого оперативного запоминающего устройства, выход которого подключен через второй ключ управления, первый пороговый декодер, четвертый ключ управления, второе оперативное запоминающее устройство, пятый ключ управления и второй пороговый декодер к первому входу мажоритарного элемента, второй вход которого подключен через буферное устройство и третий ключ управления к выходу первого порогового декодера, а выход мажоритарного элемента является выходом итеративного порогового декодера сверточного кода. |
URI: | https://libeldoc.bsuir.by/handle/123456789/42769 |
Appears in Collections: | Полезные модели |
Items in DSpace are protected by copyright, with all rights reserved, unless otherwise indicated.